Papers - IMAI Masashi
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Design and Evaluation of High Performance Microprocessor with Reconfigurable On-Chip Memory
Taku Ohneda, Masaaki Kondo, Masashi Imai, Hiroshi Nakamura
Proc. APCCAS2002 211 - 216 2002.12
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Analysis on Checkpointing Mechanism of SCore Cluster System
T.Hayashida, M.Kondo, M.Imai, H.Nakamura, T.Nanya, and A.Hori
Fastabstract of IEEE PRDC02 1 - 2 2002.12
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Flexible Partitioning of CDFGs for Compact Asynchronous Controllers
Nattha Sretasereekul, Y. Okuyama, H. Saito, M. Imai, K. Kuroda, T. Nanya
Proc. International Technical Conference on Circuits/Systems, Computers and Communications 1724 - 1727 2002.7
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Generation and Verification of Timing Constraints for Fine-Grain Pipelined Asynchrounous Data-Path Circuits
Metehan Ozcan, Masashi Imai, Takashi Nanya
Proc. Async2002 109 - 114 2002.4
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Prospect of a stanniocalcin endocrine/paracrine system in mammals.
Ishibashi K, Imai M
American journal of physiology. Renal physiology 282 ( 3 ) F367 - 75 2002.3
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遅延情報を利用した非同期式VLSI設計の一手法の提案
今井 雅,南谷 崇
電子情報通信学会技術研究報告 VLD2001 ( 120 ) 51 - 57 2001.11
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Performance evaluation of Cascade ALU architecture for asynchronous super-scalar processors
Motokazu Ozawa, Masashi Imai, Yoichiro Ueno, Hiroshi Nakamura, Takashi Nanya
Proc. Async2001 162 - 172 2001.3
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A Cascade ALU Architecture for Asynchronous Super-Scalar Processors
Motokazu Ozawa, Masashi Imai, Yoichiro Ueno, Hiroshi Nakamura, Takashi Nanya
IEICE Trans. on Electronics E84-C ( 2 ) 229 - 237 2001.2
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遅延情報を利用した非同期式RTL設計モデルの提案
今井 雅,南谷 崇
電子情報通信学会技術研究報告 VLD2000 ( 92 ) 137 - 142 2000.11
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2線式ドミノ論理による細粒度パイプライン・データパスの性能比較
今井 雅,南谷 崇
電子情報通信学会技術研究報告 CPSY99 ( 93 ) 73 - 80 1999.11
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SD符号を用いた非同期式高速除算器
中野栄治,今井 雅,中村 宏,南谷 崇
電子情報通信学会技術研究報告 CPSY99 ( 9 ) 21 - 28 1999.4
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Scalable-Delay-Insensitive Design: A high-performance approach to dependable asynchronous systems
Takashi Nanya, Akihiro Takamura, Masashi Kuwako, Masashi Imai, Motokazu Ozawa, Metehan Ozcan, Rafael Morizawa, Hiroshi Nakamura
Proc. International Symposium on Future of Intellectual Integrated Electronics 531 - 540 1999.3
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符号確定位置を考慮した非同期式SD除算器の設計と評価
中野栄治,今井 雅,中村 宏,南谷 崇
情報処理学会第58会全国大会−講演論文集(1) 51 - 52 1999.3
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Layout Methodology for SDI Model Asynchronous Circuits
Metehan Ozcan, Masashi Imai, Hiroshi Nakamura, Takashi Nanya
情報処理学会第58会全国大会−講演論文集(1) 45 - 46 1999.3
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データの符号化を考慮した非同期式データパスの評価
今井 雅,福田伸樹,中村 宏,南谷 崇
情報処理学会第58回全国大会−講演論文集(1) 47 - 48 1999.3
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DCVSLを使用した非同期式細粒度パイプライン・データパスの論理合成
今井 雅,中村 宏,南谷 崇
電子情報通信学会技術研究報告 CPSY98 47 - 54 1998.9
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非同期式プロセッサにおける複合演算の効果
今井 雅,中村 宏,南谷 崇
情報処理学会第56回全国大会−講演論文集(1) 139 - 140 1998.3
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Issues in the floor planning and layout of asynchronous VLSI systems
Metehan Ozcan,今井 雅,中村 宏,南谷 崇
情報処理学会第56回全国大会−講演論文集(1) 127 - 128 1998.3
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TITAC-2: An asynchronous 32-bit microprocessor
Akihiro Takamura, Masashi Imai, Motokazu Ozawa, Izumi Fukasaku, Taro Fujii, Masashi Kuwako, Yoichiro Ueno, Takashi Nanya
Proc. ASP-DAC98 319 - 320 1998.2
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TITAC-2: A 32-bit Asynchnorouns Microprocessor based on Scalable-Delay-Insensitive Model
Akihiro Takamura, Masashi Kuwako, Masashi Imai, Taro Fujii, Motokazu Ozawa, Izumi Fukasaku, Yoichiro Ueno, Takashi Nanya
Proc. ICCD97 288 - 294 1997.10