Papers - IMAI Masashi
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Cooling Architectures using Thermal Sidewalls, Interchip Plates, and Bottom Plate for 3D ICs
Kaoru Furumi, Masashi Imai, Atsushi Kurokawa
Proc. ISQED2017 2017.3
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A Study on Hardware Trojan Insertion in Asynchronous NoC Router
Koutaro Inaba, Toshiki Kanamoto, Atsushi Kurokawa, Masashi Imai
IEICE Technical Report A-7-1 82 - 82 2017.3
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低電圧環境における高性能非同期式回路の実現
田近龍平, 金本俊幾, 今井雅
情報処理学会東北支部研究報告 2016-6 ( B1-4 ) 2017.2
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ハンドシェイク回路多重化による低ノイズ非同期式回路の実現,
石川達也, 金本俊幾, 今井雅
情報処理学会東北支部研究報告 2016-6 ( B1-3 ) 2017.2
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多段リングオシレータによるFPGA性能ばらつきの実験的評価
増川孔明, 今井雅, 金本俊幾
情報処理学会東北支部研究報告 2016-6 ( B1-2 ) 2017.2
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極低電圧回路における消費エネルギー極小化に関する一考察
瀧健太郎, 今井雅, 金本俊幾
情報処理学会東北支部研究報告 2016-6 ( B1-1 ) 2017.2
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Hardware Trojan Comparison between Synchronous and Asynchronous Circuits
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 19 - 19 2017
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容量素子最適化のためのLSI・パッケージ・ボード電源網解析モデルの構築
葛西 孝己, 今井 雅, 黒川 敦, 金本 俊幾, 陳 俊, 橋本 昌宜, 神藤 始
電気関係学会東北支部連合大会講演論文集 2017 ( 0 ) 201 - 201 2017
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ランダム遅延素子を用いた非同期式回路の耐タンパ性向上に関する一考察
豊嶋 太樹, 金本 俊幾, 黒川 敦, 今井 雅
電気関係学会東北支部連合大会講演論文集 2017 ( 0 ) 94 - 94 2017
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Thermal-Aware Tile-Based Block Placement for 3D ICs
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 18 - 18 2017
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Task Scheduling Based Redundant Task Allocation Method for the Multi-Core Systems with the DTTR Scheme
SAITO Hiroshi, IMAI Masashi, YONEDA Tomohiro
IEICE Transactions on Fundamentals of Electronics, Communications and Computer Sciences E100.A ( 7 ) 1363 - 1373 2017
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Reducing Temperature by Relocating 3D IC Structures
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 26 - 26 2017
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PowerMOSデバイス熱設計のためのボンディングワイヤモデルの構築
太田 拓磨, 葛西 孝己, 今井 雅, 黒川 敦, 金本 俊幾, 宗形 恒夫
電気関係学会東北支部連合大会講演論文集 2017 ( 0 ) 196 - 196 2017
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Optimizing Power Distribution Network Using Multi-Objective Genetic Algorithm
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 27 - 27 2017
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Modeling and Analysis for Predicting Clock Skew of Stacked Chips
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 17 - 17 2017
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Method for Mitigating Heat of 3D Stacked Memory for Small Electronic Devices
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 28 - 28 2017
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Estimating Walking State When Holding Object in Hand by Using Neural Network
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 165 - 165 2017
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A Study on Replica Delay Circuit of Bundled-Data Transfer Asynchronous Circuits
Tohoku-Section Joint Convention Record of Institutes of Electrical and Information Engineers, Japan 2017 ( 0 ) 21 - 21 2017
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非同期式回路に対するハードウェアトロイ挿入に関する一考察
稲葉光太郎, 今井雅
ハードウェアセキュリティフォーラム2016 ポスター発表 2016.12
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非同期式回路に対するハードウェアトロイ挿入に関する一考察
稲葉光太郎, 今井雅
ハードウェアセキュリティフォーラム2016 ポスター 2016.12